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Frankrijk – Planning en uitvoering van onderzoek en ontwikkeling – Prestations de layout de circuits intégrés analogiques et mixtes

Aankondiging gepubliceerd in het Frans. De AI-analyse vat ze voor u samen in uw taal.

Acheteur public
CEA Grenoble
Grenoble
Plaats van uitvoering
Grenoble
Gegund bedrag
€ 2.000.000 excl. btw
Voorzien einde contract
7 april 2030
waarschijnlijke nieuwe aanbesteding rond oktober 2029
Ontvangen offertes
5
Vorm
Raamovereenkomst
Contract van meerdere jaren: de aankoper bestelt naargelang zijn behoeften.
Procedure
Openbare procedure
Elke onderneming mag een offerte indienen.
Publicatie
23 september 2026
Taal van de aankondiging
Frans

Analyse IA : y aller ou pas ?

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Beschrijving

Les prestations confiées au titulaire seront des prestations de layouts de blocs analogiques et mixtes. Ces blocs seront décrits sous forme de schémas annotés disponibles dans une base de données Cadence au démarrage de la tâche. Une base de données de circuit intégré rassemble notamment tous schémas constituant le circuit, organisés de façon hiérarchique.

L’implémentation physique de ces schémas va se faire en plusieurs étapes et selon plusieurs granularités. On peut les décrire ainsi : Layout d’un schéma de bloc : - Analyse du schéma :

  • Identification des points sensibles, des contraintes topologiques, des précautions d’implémentation à prendre
  • Proposition d’un floorplan du bloc et évaluation de la surface - Réalisation du layout :
  • Placement et connexion des composants
  • Proposition de modification mineure schéma si pertinent - Réalisation des vérifications :
  • DRC
  • LVS A l’issue des étapes de layout, des vues schémas intégrant les éléments parasites induits par l’implémentation physique sont extraites et simulées par les concepteurs CEA pour valider l’adéquation du layout avec la performance attendue.

En cas de performances insuffisantes, une reprise pour optimisation du layout peut être demandée. Layout d’assemblage de blocs entre eux en macro-blocs : les étapes sont sensiblement les même que pour les blocs unitaires, (analyse, layout, vérifications), mais à un niveau de hiérarchie supérieur. La complexité de ces assemblages dépend du nombre des signaux d’interface, des contraintes topologiques diverses (contraintes d’alimentations, d’isolation, de limites de surfaces…) Layout d’assemblage TOP : Il s’agit de faire l’assemblage aux plus hauts niveaux du circuit, entre les plots (souvent organisés en couronne), et les macro-blocs de plus haut niveau.

Cet assemblage est très différent si le TOP du circuit est dit « numérique » ou « analogique ». Les assemblages TOP considérés pour les tâches de layout seront uniquement des TOP analogiques.

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73300000

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Bron: TED – Publicatiebureau van de Europese Unie © Europese Unie, verwerkte gegevens. Referentie 655759-2026.